新着情報
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設計のポイントに「VHDL記述のポイント:数値リテラルの記述と型の修飾」を追加しました。
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設計のポイントに「verilog記述のポイント:taskで手続きをまとめる(functionとの違い)」を追加しました。
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設計のポイントに「verilog記述のポイント:for文による組み合わせ回路の記述」を追加しました。
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設計のポイントに「verilog記述のポイント:インデックス付きパートセレクト(+:)でビットフィールドを扱う」を追加しました。
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設計のポイントに「verilog記述のポイント:valid/readyハンドシェイクによるデータ受け渡し」を追加しました。
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設計のポイントに「verilog記述のポイント:同期FIFOの設計」を追加しました。
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設計のポイントに「verilog記述のポイント:トグル同期によるクロックドメイン間のパルス受け渡し」を追加しました。
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設計のポイントに「verilog記述のポイント:グレイコードカウンタで多ビット値をドメイン間へ渡す」を追加しました。
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設計のポイントに「verilog記述のポイント:$readmemhによるメモリ・ROMの初期化」を追加しました。
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設計のポイントに「VHDL記述のポイント:functionとprocedureの使い分け」を追加しました。


