verilog記述のポイント：モジュールの接続

設計内容分類	verilog記述のポイント

設計のポイント

あらかじめ作成されたモジュールを上位モジュールから接続することにより
容易に機能を再利用することができます。

＜作成済みモジュール＞

module sample_module(CLK,RESET,DATA);
input wire CLK;
input wire RESET;
output reg DATA;
…
endmodule

このモジュールを上位モジュールから使用(接続)するには、下記のように記述します。

sample_module U1(
.CLK(clk1),
.RESET(reset1),
.DATA(data1)
);

sample_module U2(
.CLK(clk2),
.RESET(reset2),
.DATA(data2)
);

sample_module: モジュール名
U1,U2: インスタンス名
clk1,reset1,data1,clk2,reset2,data2: 上位モジュールのポート

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